图示逻辑电路，当A＝1，B＝0时，则CP脉冲来到后D触发器状态是（ ）。 A． 保持原状态 B． 具有计数功能 C． 置“0” D． 置“1”
图示逻辑电路，当A＝1，B＝0时，则CP脉冲来到后D触发器状态是（ ）。
A． 保持原状态
B． 具有计数功能
C． 置“0”
D． 置“1”
B． 具有计数功能
C． 置“0”
D． 置“1”
参考解析
解析：D触发器的特征方程Qn＋1＝D，故电路的逻辑式为：
故当A＝1，B＝0时，则：
因此，随着CP脉冲的到来，触发器的状态Q是随着输入信号D改变，则D触发器的状态具有计数功能。
故当A＝1，B＝0时，则：
因此，随着CP脉冲的到来，触发器的状态Q是随着输入信号D改变，则D触发器的状态具有计数功能。
相关考题：
主从JK触发器的初始状态为0,在时钟脉冲CP的下降沿触发器的状态变为1,能够实现这种转换的JK取值可能为()。 A.CP=1期间，JK=10B.CP=1期间，JK=01C.CP=1期间，JK=11D.CP=1期间，JK从01变为11
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由两个主从型JK触发器组成的逻辑电路如图a）所示，设Q1、Q2的初始态是00，已知输入信号A和脉冲信号CP的波形如图b）所示，当第二个CP脉冲作用后，Q1Q2将变为（ ）。A．11B．10C．01D．保持00不变
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由两个主从型JK触发器组成的逻辑电路如图a)所示，设Q1、Q2的初始态是0、0， 已知输入信号A和脉冲信号CP的波形，如图b)所示，当第二个CP脉冲作用后，Q1、Q2将变为：A. 1、1B. 1、0C. 0、1D.保持0、0不变
下列说法不正确的是( )。A.JK触发器是在CP脉冲下降沿触发，触发后的触发器状态取决于CP脉冲下降沿前一刻的J、K值，服从JK触发器的真值表或特性方程B.C.JK触发器和D触发器可以转换为T触发器D.T触发器当输入端T=O时，每来一个CP脉冲触发，触发器的状态就改变一次
已知Q3Q2Q1Q0是同步十进制计数器的触发器输出，若以Q3作进位，则其周期和脉冲宽度是（）。A、10个CP脉冲，正脉冲宽度为1个CP周期B、10个CP脉冲，正脉冲宽度为2个CP周期C、10个CP脉冲，正脉冲宽度为4个CP周期D、10个CP脉冲，正脉冲宽度为8个CP周期
单选题已知Q3Q2Q1Q0是同步十进制计数器的触发器输出，若以Q3作进位，则其周期和脉冲宽度是（）。A10个CP脉冲，正脉冲宽度为1个CP周期B10个CP脉冲，正脉冲宽度为2个CP周期C10个CP脉冲，正脉冲宽度为4个CP周期D10个CP脉冲，正脉冲宽度为8个CP周期