用3线-8译码器74LS138和辅助门电路实现逻辑函数F=A2+A2’A1’，应（）。A、用与非门，F=（Y0’Y1’Y4’Y5’Y6’Y7’）’B、用与门，F=Y2’Y3’C、用或门，F=Y2’+Y3’D、用或门，F=Y0’+Y1’+Y4’+Y5’+Y6’+Y7’

用3线-8译码器74LS138和辅助门电路实现逻辑函数F=A2+A2’A1’，应（）。

  • A、用与非门，F=（Y0’Y1’Y4’Y5’Y6’Y7’）’
  • B、用与门，F=Y2’Y3’
  • C、用或门，F=Y2’+Y3’
  • D、用或门，F=Y0’+Y1’+Y4’+Y5’+Y6’+Y7’

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用原码输出的译码器实现多输出逻辑函数,需要增加若干个()。 A、非门B、与非门C、或门D、或非门
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利用2个74LS138和1个非门,可以扩展得到1个()线译码器。 A、4-16B、3-8C、2-4D、无法确定
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一个译码器配以适当的门电路可实现多个逻辑函数,但是逻辑函数中的自变量个数不能多于译码器输入二进制代码的位数。() 此题为判断题(对，错)。
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用数据选择器可实现任何组合逻辑函数(降维K图的应用);用二进制译码器方便实现多组合逻辑函数。() 此题为判断题(对，错)。
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TTL集成电路74LS138是3／8线译码器,译码器为输出低电平有效,若输入为A2A1A0=101时,输出:为()。 A、00100000B、11011111C、11110111D、00000100
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以下电路中,加以适当辅助门电路,()适于实现单输出组合逻辑电路A. 奇偶校验器B. 数据选择器C. 数值比较器D. 七段显示译码器
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试用3线－8线译码器74LS138和门电路实现一位二进制全减器(输入为被减数、减数与来自低位的借位;输出为差和向高位的借位)。要求用按键输入减数、被减数和进位,发光二极管显示减法结果。
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用ROM实现如下逻辑函数(采用74LS138作为地址译码器)Y1(A, B, C)=∑m (3,6,7)Y2(A, B, C)=∑m (0,1,4,5,6)Y3(A,B, C)=∑m (2,3,4)Y4(A, B, C)=∑m (2,3,4,7)
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由3-8线译码器74LS138构成的逻辑电路如图所示，该电路能实现的逻辑功能为（ ).A. 8421BCD码检测及四舍五入B.全减器C.全加器 D.比较器
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由3-8线译码器74LS138构成的逻辑电路如图所示，该电路能实现的逻辑功能为（　　）。 A． 8421码检测及四舍五入 B． 全减器 C． 全加器 D． 比较器
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1个3线-8线译码器74LS138，当输入端A＝0、B＝0、C＝1时，输出Y0和Y7的状态分别为（　　）。A． 0、0 B． 0、1 C． 1、0 D． 1、1
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1个3线-8线译码器74LS138，当输入端A=0、B=0、C=1时，输出Y0和Y7的状态分别为（）。A、0、0B、0、1C、1、0D、1、1
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数据选择器和译码器各自功能及在实现组合逻辑函数设计的区别？
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74LS138是3-8译码器。
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74LS138是具有3个输入的译码器芯片，其输出作为片选信号时，最多可以选8片芯片。（）
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以下电路中，加以适当辅助门电路，（）适于实现单输出组合逻辑电路。A、二进制译码器B、数据选择器C、数值比较器D、七段显示译码器
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74LS138是（）。A、集成3线－8线译码器B、集成3线－8线数据选择器C、集成8线－3线译码器D、集成3线－8线数据分配器
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3—8译码器74LS138在全译码寻址方式中，译码器的输出端通常与单片机接口芯片的（）端连接。
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加法器、译码器等都是逻辑门电路。
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74LS138及相应门电路可实现加法器的功能。
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使用数据选择器实现单输出函数方便，使用（）和附加逻辑门实现多数出函数方便。A、编码器B、译码器C、数值比较器D、全加器
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单选题利用2个74LS138和1个非门，可以扩展得到1个（）线译码器。A2-4B3-8C4-16D无法确定
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多选题以下电路中，加以适当辅助门电路，（）适于实现单输出组合逻辑电路。A二进制译码器B数据选择器C数值比较器D七段显示译码器
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判断题74LS138是3-8译码器。A对B错
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单选题用原码输出的译码器实现多输出逻辑函数，需要增加若干个（）。A非门B与非门C或门D或非门
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判断题74LS138集成芯片可以实现任意变量的逻辑函数。A对B错
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多选题74LS138是（）。A集成3线－8线译码器B集成3线－8线数据选择器C集成8线－3线译码器D集成3线－8线数据分配器
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