D触发器的D输入端为1，输出端Q为0时，当CP脉冲有一个有效边沿信号时，D触发器的输出信号为（）A．0B．1C．0或者1D．以上都不正确

D触发器的D输入端为1，输出端Q为0时，当CP脉冲有一个有效边沿信号时，D触发器的输出信号为（）

A．0

B．1

C．0或者1

D．以上都不正确

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相关考题：

由与非门组成的基本RS触发器当输入R=0,S=0时,同向输出端Q=____,反向输出端Q=__,当____时,输出不定状态。
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钟控触发器的在CP有效期间输入状态的改变将不影响输出状态。边沿触发方式的触发器输出状态取决于CP有效期间的输入状态。() 此题为判断题(对，错)。
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试分别画出图4-30(a)电路输出端Y、Z和图4-30(b)电路输出端Q2的波形.输入信号A和CP的电压波形如图4-30(c)所示,各触发器的初始状态为0.
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画出图题5-9所示的正边沿触发JK触发器输出Q端的波形，输入端J、K与CLK的波形如图所示。(设Q初始状态为0)
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画出图题5-11所示的脉冲JK触发器输出Q端的波形，输入端J K与CLK的波形如图所示。(设Q初始状态为0)
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画出图题5-5所示的边沿触发D触发器输出端Q端的波形，输入端D与CLK的波形如图所示。(设Q初始状态为0)
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D触发器的应用电路如图所示，设输出Q的初值为0，那么，在时钟脉冲cp的作用下，输出Q为：A.1B.cpC.脉冲信号，频率为时钟脉冲频率的1/2D.0
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由两个主从型JK触发器组成的电路如图（a）所示，设Q1、Q2的初始态是00，已知输入信号A和脉冲信号CP的波形，如图（b）所示，当第一个CP脉冲作用后，输出将为（　　）。A．00B．01C．10D．11
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D触发器的应用电路如图所示，设输出Q的初值为0，那么，在时钟脉冲CP的作用下，输出Q为:A. 1B. CPC.脉冲信号，频率为时钟脉冲频率的1/2D.0
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已知JK触发器工作时，J≠K，则在CP上的脉冲作用后，触发器输出Q的状态为（）A、Qn+1=JB、Qn+1=KC、Qn+1=1D、Qn+1=Qn
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触发器的置位端（置1端）至输出端的信号延时量一定大于触发器由输入端至输出端的延时量。
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无论J－K触发器原来状态如何，当输入端J＝1、K＝0时，在时钟脉冲作用下，其输出端Q的状态为（）。A、0B、1C、保持不变D、不能确定
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D触发器在CP端脉冲作用后，其输出Qn+1=D。
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D触发器的特点是（）A、由六个与非门组成B、信号输入端为D端C、输出端为CPD、有直接置0端E、有直接置1端
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钟控R－S触发器当（），时，触发器输出Q端为A、置0功能B、置1功能C、保持功能D、禁止状态
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当基本RS触发器的R=0，S=1时，输出端Q等于（）。
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下列哪种情况一定使JK触发器的输出端信号为“1”（）A、CP为下降沿时，J=1，K=0B、CP为下降沿时，J=K=1C、CP为下降沿时，J=0，K=1D、CP为下降沿时，J=K=0
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下列说法正确的是（）。A、一个触发器可以有一个输出端，也可以有两个输出端B、触发器两个输出端的电平可以相同，也可以相反C、时钟信号决定了触发器的翻转时刻，控制输入信号决定了触发器翻转后的状态D、时钟脉冲信号的触发都是上升沿触发
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若D触发器的输入D=1，则当CP到来后其输出Q=1。
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关于维持阻塞型D触发器说法错误的是（）。A、CP=1时，输出端的状态随着输入端的变化而变化B、CP=0时，输出端的状态随着输入端的变化而变化C、CP=1时，输出端的状态总比输入端状态变化晚一步D、边沿触发方式可以提高可靠性和抗干扰能力
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正边沿触发器在（）时，输出端的逻辑状态会发生改变（即触发有效）。A、输入逻辑电平改变B、CP脉冲从低电平变成高电平C、CP脉冲从高电平变成低电平D、高电平
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一个只有单端输入的边沿触发器，输入信号为0，原来所处状态Q=1，在时钟信号改变时，触发器状态Q变为0，则该触发器为（）。A、RS触发器B、JK触发器C、D触发器D、T触发器
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钟控R－S触发器当，S＝0，R＝1时，触发器输出Q端为（）A、置0功能B、置1功能C、保持功能D、禁止状态
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判断题若D触发器的输入D=1，则当CP到来后其输出Q=1。A对B错
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判断题触发器的置位端（置1端）至输出端的信号延时量一定大于触发器由输入端至输出端的延时量。A对B错
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单选题已知JK触发器工作时，J≠K，则在CP上的脉冲作用后，触发器输出Q的状态为（）AQn+1=JBQn+1=KCQn+1=1DQn+1=Qn
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单选题下列说法正确的是（）。A一个触发器可以有一个输出端，也可以有两个输出端B触发器两个输出端的电平可以相同，也可以相反C时钟信号决定了触发器的翻转时刻，控制输入信号决定了触发器翻转后的状态D时钟脉冲信号的触发都是上升沿触发
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判断题D触发器在CP端脉冲作用后，其输出Qn+1=D。A对B错
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