VHDL语言相对verilog语言更早成为国际标准
VHDL语言相对verilog语言更早成为国际标准
参考答案和解析
A
相关考题:
●硬件描述语言一般包括VHDL、Verilog、Superlog、SystemC等,在VHDL设计中,一个完整的设计单元应当包含5部分,下面不属于这5部分的是(32)。(32)A.实体B.结构体C.赋值D.配置
Verilog语言与C语言的区别,不正确的描述是()A、Verilog语言可实现并行计算,C语言只是串行计算;B、Verilog语言可以描述电路结构,C语言仅仅描述算法;C、Verilog语言源于C语言,包括它的逻辑和延迟;D、Verilog语言可以编写测试向量进行仿真和测试。
问答题简述VHDL语言的主要优点。