二极管或门的两输入信号AB=( )时,输出为低电平 A.11B.10C.01D.00
二极管或门的两输入信号AB=( )时,输出为低电平
A.11
B.10
C.01
D.00
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三态门的输入信号为A,输出信号为L,使能信号E低电平有效,其Verilog HDL语言描述为(将下面程序补充完整): assign L = !E ?A: _______;
A.11
B.10
C.01
D.00