Verilog HDL可以从算法级,门级到开关级的多种抽象设计层次的数字系统建模。() 此题为判断题(对,错)。

Verilog HDL可以从算法级,门级到开关级的多种抽象设计层次的数字系统建模。()

此题为判断题(对,错)。


相关考题:

什么是Verilog门级建模?

ModelSim可以帮助Quartus II 完成哪些层次的HDL仿真:A.系统级或行为级仿真B.RTL级仿真C.综合后门级仿真D.适配后门级仿真

5-1-2、数字集成电路自上而下的设计流程中,如下最底层的设计是: 。A.系统级B.门级C.晶体管级D.模块级

6、ModelSim可以帮助Quartus II 完成哪些层次的HDL仿真:A.系统级或行为级仿真B.RTL级仿真C.综合后门级仿真D.适配后门级仿真

7、Verilog可以完全完成下列哪些设计层次的描述A.电子系统级B.RTL级C.门级D.版图级物理级

Verilog可以描述门级网表

准确功耗估计的阶段有()A.系统级B.算法级C.结构级D.逻辑门级E.电路级F.版图级

1、用逻辑门描述一个全加器,是属于那个设计层次:A.晶体管级B.物理级C.门级D.系统级

17、Verilog可以描述门级网表