有关高速缓冲存储器（Cache）的说法，正确的是（）。A、只能在CPU以外B、CPU内、外都可设置CacheC、只能在CPU以内D、若存在Cache，CPU就不能再访问内存
有关高速缓冲存储器（Cache）的说法，正确的是（）。
- A、只能在CPU以外
- B、CPU内、外都可设置Cache
- C、只能在CPU以内
- D、若存在Cache，CPU就不能再访问内存
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下面是关于PC机中FCache的叙述，其中错误的是A．Cache技术利用SRAM的高速特性和DRAM的低成本特性，达到既降低成本又提高系统性能的目的B．CPU访问Cache命中时，能在零等待状态下完成数据的读写，不必插入等待周期C．CPU访问Cache未命中时，信息需从DRAM传送到CPU，这时需要插入等待周期D．尽管L2 Cache的工作频率越来越高，但不可能等于CPU的工作频率
对使用Pentium4作为CPU的PC机来说，下面关于Cache的叙述中错误的是A．L1 Cache与CPU制作在同一个芯片上B．L2 Cache的工作频率越来越高，但不可能达到CPU的工作频率C．CPU访问Cache时，若“命中”，则不需插入等待状态D．Cache是CPU和DRAM主存之间的高速缓冲存储器
下面是关于微型计算机存储系统是的层次结构描述正确的是()A.CPU.内存.cachB.外存B、CPU、cache、内存、外存C.内存、cache、CPU、外存D.内存、cache、外存、CPU
高速缓冲存储器 Cache是位于CPU和主存DRAM之间规模或容量较小但速度很快的存储器。下面是关于Cache的叙述，其中错误的是( )。A．PC中采用的Cache方案兼顾了SRAM的高速特性和DRAM的低成本特性，即达到了即降低成本又提高系统性能的目的B．CPU访问Cache“命中”时，由于Cache的速度与CPU相当，因此CPU就能在零等待状态下迅速地完成数据的读写，而不必插入等待状态C．CPU访问CaChe“未命中”时，信息需从主存(DRAM)传送到CPU，这时CPU要插入等待状态D．L1 Cache的工作频率和CPU的工作频率相等，L2 Cache的工作频率越来越高，但不可能等于CPU的工作频率
在主存和CPU之间增加Cache的目的是(17)。在CPU执行一段程序的过程中，Cache的存取次数为2250次，由内存完成的存取次数为250次。若Cache的存取周期为6ns，内存的存取周期为24ns，则Cache的命中率为(18)，CPU的平均访问时间为(19)ns。A．提高内存工作的可靠性B．扩展内存容量C．方便用户操作D．提高CPU数据传输速率
下面关于Cache的叙述，错误的是（）A、高速缓冲存储器简称CacheB、Cache处于主存与CPU之间C、程序访问的局部性为Cache的引入提供了理论依据D、Cache的速度远比CPU的速度慢
以下关于cache的阐述中，（）是不对的。A、CPU存取cache中的数据较快B、cache封装到CPU芯片内C、cache是介于CPU和硬盘驱动器之间的存储器D、cache是介于CPU和内存之间的高速存储器
下面是关于CPU访问主存和高速缓存CAChe关系描述，正确的有（）A、没有CAChe的微机，只有主存能与CPU直接进行信息交换B、拥有CAChe的微机，CAChe和主存都能直接与CPU交换信息C、一台装有CAChe的微机，CPU从外存读人数据的顺序是外存→主存→CACheD、CAChe使用的是半导体动态存储器，所以其中的信息不能长期保留
关于高速缓冲存储器cache的描述，不正确的是（）A、cache-是介于cPu和内存之间的一种可高速存取信息的芯片B、cache越大，效率越高C、cache用于解决cPu和RAM之问速度冲突问题D、存放在cache中的数据使用时存在命中率的问题
下面是对高速缓冲存储器（CAChe）的描述，正确的有（）A、CAChe是位于CPU与主存储器之间，对用户是透明的一种高速小容量存储器B、在现代CPU设计技术中，常将CAChe分成一级CAChe和二级CACheC、一级CAChe容量一般较小，二级CAChe的容量相对一级CAChe要大一些D、高速缓存中存放的是正在运行的一小段程序和数据
下面是关于微型计算机存储系统是的层次结构描述正确的是（）A、CPU．内存．cache．外存B、CPU、cache、内存、外存C、内存、cache、CPU、外存D、内存、cache、外存、CPU
单选题关于高速缓冲存储器cache的描述，不正确的是（）Acache-是介于cPu和内存之间的一种可高速存取信息的芯片Bcache越大，效率越高Ccache用于解决cPu和RAM之问速度冲突问题D存放在cache中的数据使用时存在命中率的问题