由JK触发器装换成的T触发器，其输出状态在CP脉冲的()时变化。A.高电平B.低电平C.上升沿到来D.下降沿到来
异步时序逻辑电路中各个触发器所用的时钟触发沿不完全相同。() 此题为判断题(对，错)。
下列触发器中,()不可作为同步时序逻辑电路的存储元件 A.基本R-S触发器B.D触发器C.J-K触发器D.T触发器
钟控RS触发器的触发时刻为( ) A、CP=1期间B、CP=0期间C、CP上升沿D、CP下降沿
下列说法不正确的是( )。A.JK触发器是在CP脉冲下降沿触发，触发后的触发器状态取决于CP脉冲下降沿前一刻的J、K值，服从JK触发器的真值表或特性方程B.C.JK触发器和D触发器可以转换为T触发器D.T触发器当输入端T=O时，每来一个CP脉冲触发，触发器的状态就改变一次
同步时序逻辑电路中各触发器的时钟脉冲CP是同一个信号。
异步时序逻辑电路中各触发器状态变化不是发生在同一时刻，但必须要有时钟脉冲。
下列触发器中没有约束条件的是（）。A、基本RS触发器B、主从RS触发器C、钟控RS触发器D、钟控JK触发器
（）触发器是JK触发器在J=K条件下的特殊情况的电路。A、DB、TC、RSD、钟控触发器
触发器的触发方式为（）。A、高电平触发B、低电平触发C、上升沿触发D、下降沿触发E、斜坡触发
由D触发器转换成的T触发器其输出状态是在CP脉冲的（）时变化。A、下降沿到来B、上升沿到来C、低电平D、高电平
下列触发器中，（）不可作为同步时序逻辑电路的存储元件。A、基本R-S触发器B、D触发器C、J-K触发器D、T触发器
边沿控制触发的触发器的触发方式为（）。A、上升沿触发B、下降沿触发C、可以是上升沿触发，也可以是下降沿触发D、可以是高电平触发，也可以是低电平触发
下列（）触发器是JK触发器在J≠K条件下的特殊情况的电路。A、DB、TC、RSD、钟控触发器
在同步时序逻辑电路中，触发器的输出称为（）变量，触发器的输入又称为（）信号。
同步时序逻辑电路中，所有触发器状态的变化都是在（）操作下（）进行的；异步时序逻辑电路中，各触发器的时钟信号（），因而触发器状态的变化并不都是（）发生的，而是（）
脉冲异步时序逻辑电路中的存储元件可以采用（）A、时钟控制RS触发器B、D触发器C、基本RS触发器D、JK触发器
静态RAM中的存储单元是（）。A、D触发器B、JK触发器C、基本RS触发器D、钟控D触发器
关于异步时序逻辑电路，下面表述不正确的是（）。A、异步时序逻辑电路一般简称异步电路B、异步电路中触发器用的时钟不同C、异步电路中有的触发器不需要时钟D、异步电路没有同步电路应用广泛
关于触发器，以下说法错误的（）。A、触发器是组成组合逻辑电路的基本单元B、触发器是组成时序逻辑电路的基本单元C、触发器具有记忆功能D、触发器有两个稳定状态
关于同步时序逻辑电路，下面表述正确的是（）。A、所有触发器类型相同B、所有触发器的时钟相同C、比同样功能的异步时序逻辑电路简单D、没有异步清0功能
用TC787集成触发器组成的六路双脉冲触发电路具有（）的脉冲封锁功能。A、低电平有效B、高电平有效C、上升沿有效D、下降沿有效
JK触发器都是下降沿触发的，D触发器都是上升沿触发的。
单选题由D触发器转换成的T触发器其输出状态是在CP脉冲的（）时变化。A下降沿到来B上升沿到来C低电平D高电平
单选题存在空翻问题的触发器是（）AD触发器B钟控RS触发器C主从JK触发器D维持阻塞D触发器
多选题触发器是存储电路的基本元件，根据触发器时钟端的连接方式，把时序逻辑电路分为（）。A同步时序电路B组合逻辑电路C触发器电路D异步时序电路